SPARC T5
SPARC T5は、オラクルのSPARC Tシリーズファミリの第5世代マルチコアマイクロプロセッサである。2012年8月のHotChips 24で最初に発表され、2013年3月にOracle SPARC T5サーバーで正式に導入された。プロセッサは、シングルスレッドとマルチスレッド（チップあたり16コア、コアあたり8スレッド）両方で高いパフォーマンスを得られるよう設計された。

このプロセッサは、その前身であるSPARC T4プロセッサと同じSPARC S3コアの設計だが、28 nmプロセスで実装され、3.6GHzで動作する。 S3コアは、ダイナミックスレッディングとアウトオブオーダー実行を使用するデュアルイシューコアである。そして、コアごとに1つの浮動小数点演算コプロセッサ (FPU) と専用の暗号化ユニットを1つ組み込んでいる。

64ビットSPARC V9ベースのプロセッサには、プロセッサあたり最大128スレッドをサポートする16コアがあり、8ソケットシステムで最大1,024スレッドまで拡張できる。その他には、PCIeバージョン3.0のサポートと、新しいキャッシュコヒーレンスプロトコルなどが変更点となる。
Q19900
オラクル
ORG
Q390864
SPARC Tシリーズ
UNK
Q555032
マルチコア
Concept
Q5297
マイクロプロセッサ
Concept
Q2476777
SPARC T4
MISC
Q213092
ダイナミックスレッディング
Concept
Q1153762
アウトオブオーダー実行
UNK
Q733507
浮動小数点演算コプロセッサ
Concept
Q141090
暗号化
Concept
Q15732922
SPARC T5
Concept
Q15732922
SPARC T5
Concept
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24
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