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  正反器可以分成幾種常見的型別: SR (設定-重置,"set-reset"), D (資料或延遲,"data" or "delay"), T(反轉,"toggle"),和JK。 以上型別的正反器皆可用特徵方程,以現有的輸入、輸出訊號(Q),匯出下個(即下個時鐘脈衝的)輸出()。

  基本RS觸發器又稱SR鎖存器,是觸發器中最簡單的一種,也是各種其他型別觸發器的基本組成部分。兩個與非門或或非門的輸入端輸出端進行交叉耦合或首尾相接,即可構成一個基本RS觸發器。  當R與S皆為低電位,回授會讓Q與(Q的反相)保持於一個固定的狀態。當S("Set")為高電位,R("Reset")為低電位時,輸出Q會被強制設定為高電位;相反的,當S為低電位,R為高電位時,輸出Q會被強制設定為低電位。  特徵方程為formula_1,且RS=0。

  D觸發器有一個輸入、一個輸出和一個時脈輸入,當時脈由0轉為1時,輸出的值會和輸入的值相等。此類觸發器可用於防止因為噪聲所帶來的錯誤,以及通過管線增加處理資料的數量。  formula_2  真值表如下:

  JK 觸發器設有兩個輸入,其輸出的值由以下的算式來決定。  formula_3  JK觸發器和觸發器中最基本的RS觸發器結構相似,其區別在於,RS觸發器不允許R與S同時為1,而JK觸發器允許J與K同時為1。當J與K同時變為1的同時,輸出的值狀態會反轉。也就是說,原來是0的話,變成1;原來是1的話,變成0。 對應表如下:

  T觸發器(Toggle Flip-Flop,or Trigger Flip-Flop)設有一個輸入和輸出,當時脈由0轉為1時,如果T和Q不相同時,其輸出值會是1。輸入端T為1的時候,輸出端的狀態Q發生反轉;輸入端T為0的時候,輸出端的狀態Q保持不變。把JK觸發器的J和K輸入點連線在一起,即構成一個T觸發器。  因此T觸發器的算式為:  formula_4

  在一個較為複雜的數字系統中,需要多個觸發器翻轉時間同步,這時候需要附加門控電路而構成同步觸發器。

  為了防止空翻現象對觸發器實際工作的影響,主從結構觸發器被研製出來。

  它由兩個同步RS觸發器以及一個反相器所構成。

  由於主從觸發器對輸入訊號有所約束,又開發出了主從JK觸發器。

  在正反器的資料手冊一般會標示元件的建立時間(t)及維持時間(t),一般會是以奈秒(ns)為單位,有些先進的正反器可以到數百皮秒(ps)。若資料及控制輸入從取樣時鐘邊沿之前就維持定值,且時間超過建立時間,在取樣時鐘邊沿之後就維持定值,且時間也超過維持時間,可以避免正反器的亞穩態現象。
觸發器(英語:Flip-flop, FF),中國大陸譯作「zh」、臺灣及香港譯作「zh」,是一種具有兩種穩態的用於儲存的元件,可記錄二進位制數字訊號「1」和「0」。觸發器是一種雙穩態多諧振盪器(英語:bistable multivibrator)。該電路可以通過一個或多個施加在控制輸入端的訊號來改變自身的狀態,並會有1個或2個輸出。觸發器是構成時序邏輯電路以及各種複雜數字系統的基本邏輯單元。觸發器和鎖存器是在計算機、通訊和許多其他型別的系統中使用的數位電子系統的基本組成部分。